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Intel Knights Landing (14 nm) integrará el acelerador Xeon Phi

19 de junio, 2013 |
Iván Aparicio |
Comentarios: 6
| DarkVision Hardware
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Tags: Intel Servidores, Procesadores

Comentarios:

1 : Izanagi  (639 comentarios)

19/06/2013 9:09:25
Es como decir todo y nada a la vez. Poco he sacado en claro con esta noticia l verdad.
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2 : PibeTp  (488 comentarios)

19/06/2013 12:09:33
¿Acaso el PCIEx 3.0 está saturado? ¿Y por discos duros según la noticia?

La primera noticia que leo al respecto.

Vale que el SSD de ADATA fuera PCIEx 4.0 (¿que versión?) pero de ahí a saturar el bus PCIEx...

Saludos,
Pibe
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3 : uchihas  (948 comentarios)

19/06/2013 14:15:31
No me gusta nada que en un sobremesa integren tanto en el mismo chip, ya se está viendo con Haswell que limita muchísimo en potencial de OC y aumenta bastante las temperaturas.

#2

Si te fijas por ejemplo los SLI/CF van mejor en Intel que en AMD, tal vez se refiera a eso, que no es un cuello de botella del PCIe si no de la gestión que haga el procesador, y meter el Xeon Phi como co-procesador pordría quitar ese cuello de botella.
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4 : Alex  (264 comentarios) - Administrador

19/06/2013 15:44:36
Me ha hecho gracia el nombre: Knights Landing
Me recuerda a Juego de Tronos, por lo de King's Landing (ciudad de Desembarco del Rey)

Será casualidad? Mmmmm...

5 : p35  (197 comentarios)

19/06/2013 19:34:05
#4
te doy 1 deacuerdo
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6 : fusion  (158 comentarios)

20/06/2013 3:05:21
Este movimiento por parte de Intel es para hacer frente al procesamiento GPGPU esto es equivalente a una APU.
Si tuvieron la posibilidad de probar realmente la potencia bruta de una simple APU aprovechando la GPU sabran el poder que tienen estas.
Por un lado Intel hace rato intenta frenar el calculo GPU dado que no tiene realmente con que competir, si los desarrolladores realmente aprovechasen esta potencia los azules quedarían muy mal parados.
Lo que si tiene a favor Intel es la compatibilidad, y simplicidad de optimización para sus xeon phi.

2# El tema no es el bus PCIE saturado, sino que no hay comparación a nivel performance en tener las unidades que participen del calculo en una misma pastilla o tenerlas trabajando con un bus de por medio.
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