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Detalles del AMD K8L (actualizado)

6 de junio, 2006 | Por Ferran Veciana | lecturas: 19415 | 12 coment. 
Fuente: Daily Tech
En la web de Daily Tech podemos leer más detalles sobre el futuro procesador de AMD llamado en clave K8L, clasificado como un procesador de nueva arquitectura, según AMD.

Uno de los puntos fuertes de la nueva arquitectura es que es modular (controlador de memoria, memoria cache de nivel 3, etc...) y por lo tanto puede irse mejorando y ampliando por partes. Veremos a la práctica como se traduce esto.

También detallaron que cada core del K8L tendrá 64KB de caché L1 dedicada (32KB data + 32KB instruction), luego 512KB de caché L2 también dedicada y finalmente una caché L3 de 2MB compartida para todos los núcleos. Aunque afirman que en sus planes está ampliar esta cifra. Según AMD la reducción de cache L1 tiene lógica con la inclusión de la L3.

Otra característica es DICE (Dynamic Independent Core Engagement) que significa que cada core es independiente a nivel de energia y será automáticamente desconectado cuando no haya necesidad de su uso o estemos utilizando aplicaciones con menos hilos que cores dispongamos, por ejemplo la mayoría de juegos actuales. Así ahorramos en consumo y calor.

También hablaron de los Opteron basados en esta arquitectura que pasarán a disponer de 4 en vez de 3 conexiones de 16 bits con el bus HyperTransport 3.0 que funcionará a 2,6Ghz. También se podrán reconfigurar estas 4 conexiones de 16 bits a 8 conexiones de 8 bits. Esto permitirá disponer de plataformas con 8 procesadores uniendo así, 32 núcleos en total.

La arquitectura del K8L está pensada para 4 núcleos aunque se supone que existirán modelos de 2 núcleos.

Actualizado: Parece que no han reducido la caché L1, aunque la frase es algo confusa: "One thing AMD representatives have not particuarly touched on is the cache reduction from 64+64KB (data+instruction) to 32+32KB.".
Grupos: AMD
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